锁存

网络释义

1.
latch
问题9：锁存 （Latch）与锁存/触发（Latch/ Retrigger ）有何区别？问题10：FM350－1的锁存功能是否能产生过程中断？
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2.
Latched
十进制计数器CD4553/CC4553/MC14553中文资料 ... Advance 进行 Latched 锁存 Characteristic 参数 ...
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3.
LOCK
DMA - fanzhenhua的专栏 - 博客频道 - CSDN.NET ... D/C 数据/控制 LOCK# 锁存 TWE#TAG 写效能 ...
blog.csdn.net|基于29个网页
4.
Latches
SNAP Ethernet I/O系统特性：1）状态锁存（Latches）： （数字量I/O）设定数字量I/O的状态锁存功能，可以监测I/O的工作状 …
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5.
latching
New Page 1 ... latch 锁存器 latching 锁存 latency time 等待时间 ...
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6.
WEL
执行设置写使能锁存（WEL）位之前发送页编程（PP）.如果八个最低有效地址是不是所有的0位（A7-A0）,超越当前页面的所 …
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7.
ALE
锁存(ALE)、读／写使能(RE，WE)和片选(CE)等控制线，必须通过特定的逻辑来操作。NANDFLASH不支持线性寻址，一般不 …
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8.
UVLO
未来公司将重回高速成长之路，古永锵表示，输入电压低于阈值电压时，输出锁存（UVLO），网管能力强。至此，MS与GPR…
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例句

释义:
全部全部,latchlatch,LatchedLatched,LOCKLOCK
类别:全部全部,口语口语,书面语书面语,标题标题,技术技术
来源:全部全部,字典字典,网络网络
难度:全部全部,简单简单,中等中等,难难
1.
A set of edge-triggered (or equivalent) latches which jointly store the state of a binary value through a clock cycle is termed a register.
用一组沿触发（或等价的）锁存器在一个时钟周期内共同地存储一个以二进制数表示的状态，就称为寄存器。
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2.
In an embodiment, the system includes a first latch and a pulse generator coupled to provide a timing signal to the first latch.
在实施例中，所述系统包含第一锁存器和经耦合以将时序信号提供给所述第一锁存器的脉冲产生器。
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3.
The side latches have sections adapted to be deflected in an inward direction to un-latch the TPA member from the pre-lock position.
侧面锁存器具有适合于在向内的方向上被偏转的部分以将所述TPA元件从预锁定位置解锁。
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4.
The dynamic latch is adapted to generate an amplified output data signal based at least in part on the input data signal.
所述动态锁存器适于至少部分基于输入数据信号产生放大的输出数据信号。
ip.com
5.
Each of these BiCMOS devices includes a CMOS shift register, accompanying data latches, and NPN constant-current sink drivers.
每个BiCMOS器件包含一个CMOS移位寄存器、随附的数据锁存和NPN恒流灌电流驱动器。
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6.
The data in the output latch can then be read by the host system any time before the end of the next conversion.
中的数据输出锁存器就可以读取主机系统的任何时间在年底前下一次转换。
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7.
The invention relates to a flip latch and a liquid crystal display source drive device.
本发明涉及一种锁存器及液晶显示源极驱动装置。
ip.com
8.
The synchronized switching control signals by the specific latch govern the current amount through the output load resistance.
通过相应的锁存器产生同步的开关控制信号来控制流经输出端负载电阻的总电流量。
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9.
Buffer acquisition is managed through the use of latches, known as mutex, and lock-access information.
缓冲区的获取是通过使用锁存器（latch）和锁访问信息来管理的，该锁存器称作mutex。
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10.
On a truly asynchronous clock boundary, the receiving domain's clock is used to capture each signal from the driving domain in a flip-flop.
在设计中，常常会用一个触发器接收来自于另一个时钟域的输出信号（即用本地时钟的前沿来锁存另一个时钟域的信号）。
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